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发一个用cordic算法实现取模运算的verilog代码

标签： cordic 取模运算 verilog 代码

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Verilog实现APB总线接口的计数器

标签： Verilog

Verilog实现APB总线接口的计数器,支持周期配置立即生效和延迟生效

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VerilogHDL扫盲文_Verilog入门材料_

标签： Verilog入门材料

Verilog入门材料

Verilog语言生成正弦波

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8x8led.rar_FPGA点阵显示_verilog字符点阵_点阵 verilog 8*8_点阵VERILOG滚动_点阵显示V

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基于FPGA的8X8点阵控制，显示字符。verilog语言

rgmii的verilog实现

标签： rgmii fpga verilog iddr

使用verilog实现的rgmii接口转换时序，将在上升沿和下降沿同时传输数据转换为上升沿数据

基于Cordic算法求反正切的Verilog及Matlab实现.zip

标签： Cordic atan verilog matlab

本文是根据Cordic算法原理，利用二分法思想，完成对任意输入值求反正切的Verilog编写及Matlab程序仿真，并且自创扩展到四象限，可以求（-180~180）全相位的反正切值，是求反正切非常实用的手段。

双线性插值FPGA代码Verilog

标签：双线性插值 FPGA Verilog

双线性插值算法的FPGA实现，Verilog代码，分享给大家一起学习！

APB_slave.zip_Apb_apb slave_apb slave verilog_apb verilog_verilo

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APB slave template for AMBA bus written in Verilog

异步FIFO，Verilog源码

标签： FIFO Verilog

异步FIFO，Verilog源码实现异步FIFO，异步FIFO的原理,

FPGA流水呼吸灯verilog HDL设计

标签： FPGA verilog 流水灯呼吸灯

该程序是基于FPGA verilog HDL设计的一个流水呼吸灯的设计（4个LED实现流水和呼吸的效果），适合初学者学习，博客： https://blog.csdn.net/qq_40261818/article/details/81360202

7段数码管显示Verilog程序

标签： 7段数码管 Verilog

此压缩文件为计数器和7段数码管显示功能，使用Verilog语言描述的模块

Verilog入门教程，共002-013

标签： Verilog

Verilog入门教程，共002-013，001，上传时已经存在，请关注002-013，侵权请联系管理员删除

verilog2001标准

标签： verilog

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verilog编写的0-15计数器

标签： 16位计数器 verilog

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Verilog数字系统设计（夏宇闻）第3版.zip

标签： Verilog VHDL fpga

本压缩包主要是夏宇闻编写的Verilog数字系统设计，这是第3版的课程资源的pdf版本，内容涵盖492页，带书签，字迹清晰，适合初学FPGA的人学习观看.

verilog-format的配置文件

标签： fpga开发 verilog

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PRESENT密码算法的Verilog实现

标签： HDL 密码算法加密

基于verilog的PRESENT加密算法，包含源码、testbench、Quartus II的波形文件等等，加密结果检验正确，可以通过modelsim看所有中间变量结果。

Verilog数字系统设计教程第3版夏宇闻 2013 带书签

标签： Verilog 数字系统设计教程第3版夏宇闻

北航出版社，夏宇闻老师编著的《Verilog数字系统设计教程》第3版，2013 带目录书签。经典书籍教材，值得学习。

verilog 两种方法实现除法器

标签： verilog除

基于verilog的两种方法（算法），实现的除法器，可在modelsim和总和软件中总和验证

verilog实现sin计算

标签： verilog sin

verilog实现sin计算具体解释参考http://blog.csdn.net/yunge812/article/details/79456267

Verilog-FIR：使用Verilog实现FIR

标签： matlab verilog fir verilog-fir MATLABVerilog

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verilog实现的以太网并行crc校验

标签： verilog crc

verilog实现的并行crc校验。公式为1+x^1+x^2+x^4+x^5+x^7+x^8+x^10+x^11+x^12+x^16+x^22+x^23+x^26+x^32

Perl_for_Verilog：一些用于Verilog HDL的有用工具

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w25q128 verilog仿真模型

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循环冗余检查(CRC)是一种数据传输检错功能，对数据进行多项式计算，并将得到的结果附在帧的后面，接收设备也执行类似的算法，以保证数据传输的正确性和完整性。若CRC校验不通过，系统重复向硬盘复制数据，陷入死循环...

”verilog“ 的搜索结果

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